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ZW100 DSP内核设计与实现

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ZW100 DSP内核设计与实现
论文目录
 
摘要第1-5页
ABSTRACT第5-8页
第一章 绪论第8-14页
  1.1 研究背景与意义第8页
  1.2 国内外研究现状与发展趋势第8-11页
  1.3 本文研究内容和指标要求第11页
  1.4 论文组织结构第11-14页
第二章 ZW100DSP核体系架构第14-28页
  2.1 ZW100指令集概述第14-19页
    2.1.1 指令类型划分第14-15页
    2.1.2 指令语法第15-16页
    2.1.3 指令编码设计第16-18页
    2.1.4 指令时序第18-19页
  2.2 ZW100DSP核整体架构第19-22页
    2.2.1 ZW100DSP核结构框图第19-20页
    2.2.2 ZW100DSP核关键特征第20-21页
    2.2.3 寄存器结构第21页
    2.2.4 数据类型第21-22页
    2.2.5 数据格式第22页
  2.3 中断与陷阱第22-25页
    2.3.1 中断处理系统第22-24页
    2.3.2 陷阱处理系统第24-25页
    2.3.3 中断与陷阱响应优先级顺序第25页
  2.4 片上调试系统第25-26页
  2.5 设计方法与工具流程第26-27页
    2.5.1 设计方法第26页
    2.5.2 工具流程第26-27页
  2.6 本章小结第27-28页
第三章 处理模块设计第28-46页
  3.1 处理模块功能第28-29页
  3.2 指令取指模块第29页
  3.3 数据存取模块第29-35页
    3.3.1 存取控制通路第31-33页
    3.3.2 存取数据通路第33-35页
  3.4 数据运算模块第35-45页
    3.4.1 指令译码单元第36-37页
    3.4.2 指令控制单元第37页
    3.4.3 数据前推逻辑第37-39页
    3.4.4 算术逻辑单元第39-43页
    3.4.5 乘加运算单元第43-45页
  3.5 本章小结第45-46页
第四章 流水线控制模块设计第46-58页
  4.1 流水线技术第46-48页
    4.1.1 超标量技术第46-47页
    4.1.2 超长指令字技术第47-48页
    4.1.3 ZW100DSP流水线设计第48页
  4.2 流水线事件处理模块第48-57页
    4.2.1 模块功能第48-49页
    4.2.2 模块结构第49-50页
    4.2.3 主事件逻辑第50-52页
    4.2.4 外部中断第52-53页
    4.2.5 CPU暂停状态第53页
    4.2.6 外部休眠状态第53页
    4.2.7 循环流水线译码阶段事件逻辑第53-54页
    4.2.8 数据运算流水线译码阶段陷阱第54-55页
    4.2.9 数据存取流水线译码阶段事件逻辑第55-56页
    4.2.10 待处理事件逻辑和多周期状态计算逻辑第56-57页
  4.3 内核调试控制模块第57页
    4.3.1 模块功能第57页
    4.3.2 模块结构第57页
  4.4 本章小结第57-58页
第五章 DSP核版图实现与功能验证第58-68页
  5.1 版图实现第58-59页
  5.2 定向验证第59-60页
    5.2.1 指令集验证第59-60页
    5.2.2 异常程序流验证第60页
  5.3 随机验证第60-62页
  5.4 澳门美高梅真人娱乐官网程序验证第62页
  5.5 仿真验证及分析第62-67页
  5.6 本章小结第67-68页
第六章 工作总结与展望第68-69页
  6.1 总结第68页
  6.2 展望第68-69页
参考文献第69-71页
致谢第71-72页
攻读硕士期间发表的论文第72页

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