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突发通信发射机设计及相关模块FPGA实现

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突发通信发射机设计及相关模块FPGA实现
论文目录
 
摘要第1-6页
ABSTRACT第6-10页
符号对照表第10-12页
缩略语对照表第12-17页
第一章 绪论第17-21页
  1.1 研究背景和意义第17-18页
  1.2 研究进展以及发展趋势第18-19页
  1.3 项目要求及章节安排第19-21页
第二章 理论基础及关键技术第21-35页
  2.1 扩频通信的基本原理第21-24页
    2.1.1 理论基础第21-22页
    2.1.2 直接序列扩频技术第22-23页
    2.1.3 跳频扩频第23页
    2.1.4 跳频系统的原理第23-24页
    2.1.5 多进制扩频系统第24页
  2.2 RS编码第24-28页
    2.2.1 RS码的概念第24-25页
    2.2.2 RS码的编码原理第25-26页
    2.2.3 RS码的LFSR编码实现第26-27页
    2.2.4 RS码的译码原理第27-28页
  2.3 直接频率合成技术(DDS)第28-29页
  2.4 基于DA算法的多相滤波器技术第29-33页
    2.4.1 多相滤波器[24]技术第29-31页
    2.4.2 基于DA算法的滤波器结构第31-33页
  2.5 本章小结第33-35页
第三章 硬件平台设计及FPGA方案设定第35-45页
  3.1 硬件平台设计第35-40页
    3.1.1 发射机总体结构设计第35页
    3.1.2 FPGA芯片选择、内部特点和相关电路第35-37页
    3.1.3 ARM控制芯片的的选择第37页
    3.1.4 数模转换芯片DAC5682Z第37-38页
    3.1.5 频率合成器的选择第38-40页
  3.2 电路设计第40-41页
    3.2.1 电源电路第40页
    3.2.2 时钟电路第40-41页
  3.3 系统FPGA方案设计及参数设定第41-43页
    3.3.1 系统FPGA方案设计第41-42页
    3.3.2 PN码的选择第42页
    3.3.3 帧格式组成第42页
    3.3.4 跳频的实现第42-43页
  3.4 本章小结第43-45页
第四章 系统相关模块FPGA实现第45-65页
  4.1 全局时钟和控制部分第45-47页
    4.1.1 时钟管理模块第45-46页
    4.1.2 总体控制模块第46-47页
  4.2 FPGA数字信号处理部分设计第47-55页
    4.2.1 RS编码模块第47-48页
    4.2.2 数据缓存模块第48-49页
    4.2.3 组帧模块第49页
    4.2.4 扩频模块第49-50页
    4.2.5 波形成形模块第50-51页
    4.2.6 多相滤波器模块第51-53页
    4.2.7 数字IQ调制第53-55页
  4.3 接口部分第55-62页
    4.3.1 ARM数据读取控制第56-57页
    4.3.2 LVDS模块第57-60页
    4.3.3 跳频设计(ADF4350)第60-62页
  4.4 系统测试第62-64页
  4.5 本章小结第64-65页
总结与展望第65-67页
参考文献第67-71页
致谢第71-73页
作者简介第73页
  1. 基本情况第73页
  2. 教育背景第73页
  3. 攻读硕士学位期间的研究成果第73页

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